杰克erickson,Mathworks
低延迟视频处理应用程序依赖于FPGA和ASIC硬件来处理大量传入的像素数据。但是高分辨率格式,例如4k和8k,高帧速率视频每秒包含太多像素以串行处理。数字硬件允许并行性,但是许多算法,如过滤器和边缘检测操作,在连续像素的窗口上运行,使得具有有效的并行处理具有挑战性的窗口。
Vision HDL Toolbox™本身支持每个时钟处理万博1manbetx。其帧到像素和像素到帧网关块提供简单的设置,以便并行地将设计的输入和从一个像素输出到4或8。万博1manbetx支持的算法,例如此示例中所示的图像滤波器和边缘检测器块,基于此指定的并行级别自动更新其体系结构。它们以适当的延迟模拟此行为,并使用HDL Coder™生成合成的RTL,该RTL共享这些重叠邻域处理窗口之间的资源。结果是资源使用率与每个时钟的像素数缩放。
要利用此功能来开发自定义多点像素 - 每钟算法,请使用如图所示的行缓冲区块这个视频。
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