杰克·埃里克森MathWorks
低延迟视频处理应用依赖FPGA和ASIC硬件来处理大量输入像素数据。但4k和8k等高分辨率格式以及高帧率视频每秒包含太多像素,无法连续处理。数字硬件允许并行,但许多算法,如过滤器和边缘检测操作在连续像素的窗口,使有效的并行处理具有挑战性。
Vision HDL Toolbox™本地支持每时钟多像素万博1manbetx处理。它的帧到像素和像素到帧网关块提供了简单的设置,将设计的输入和输出从一个像素一次切换到4或8个并行。万博1manbetx支持的算法,如本例中所示的Image Filter和Edge Detector块,会根据指定的并行级别自动更新它们的架构。它们用适当的延迟来模拟这种行为,并使用HDL Coder™生成可合成的RTL,在这些重叠的邻域处理窗口之间共享资源。结果是,资源使用随每个时钟的像素数量呈次线性扩展。
要利用这种能力来开发自定义的多像素每时钟算法,请使用如下所示的Line Buffer块这个视频。
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