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使用HDL编码器™ 软件,您可以在模型中为AXI4流、AXI4流视频或AXI4主映射实现简化协议。软件生成具有相应接口的HDL IP核。
AXI4从接口生成的模型设计
如何为标量、矢量端口、总线数据类型和回读值的AXI4或AXI4 Lite接口设计模型。
AXI4流接口生成模型设计
如何为AXI4流向量或标量接口生成设计模型。
AXI4流视频接口生成模型设计
如何使用AXI4流视频接口设计IP核心生成模型。
AXI4主界面生成的模型设计
描述AXI4主协议,以及如何使用AXI4主接口设计IP核心生成模型。
使用AXI4流接口在Zynq硬件上实现处理器和FPGA之间的高速数据传输。
使用AXI4流视频接口在生成的HDL IP核上启用高速视频流。
使用AXI4主接口生成HDL IP核,在HDL IP核中执行矩阵乘法,并将输出结果写入DDR内存。
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