领域专家和硬件工程师使用MATLAB®和仿真软万博1manbetx件®开发在Xilinx上部署的原型和生产应用程序®FPGA和Zynq®SoC设备。
使用MATLAB和Simulin万博1manbetxk，您可以:
- 在系统级对硬件架构建模
- 编程您的FPGA或SoC，无需编写任何代码
- 使用MATLAB和Simulink产品模拟和调试您的FPGA或SoCs manbetx 845万博1manbetx
- 为FPGA或SoC集成生成生产HDL和C代码
“我们在我们的领域有丰富的经验，但在FPGA集成方面的经验很少。万博1manbetxSimulink和HDL Coder使我们能够专注于为我们的产品设计智能算法，而不是如何在特定的FPGA上运行这些算法。”
鲍里斯·范·阿莫龙根，奥罗里亚
建模与仿真
万博1manbetxSimulink for Model-Based Design使您能够减少Xilinx FPGA和Zynq SoC应用程序的开发时间，通过对硬件实现进行高层建模并在系统上下文中进行模拟。你也可以量子化定点为了更有效地利用资源，或生成可合成的本机浮点HDL更容易fpga程序．
HDL Coder™生成合成的VHDL®或Verilog®直接从HDL-ready Simulink和MA万博1manbetxTLAB函数块的应用程序，如信号处理，无线通信，电机和电源控制,图像/视频处理．
用于DSP的Xilinx系统生成器而且Xilinx模型编写器向Simulink中添加特定于xilinx的块，用于系统级模万博1manbetx拟和硬件部署。您可以将System Generator块与本地Simulink块集成，以生成HDL代码。万博1manbetx
SoC Blockset™让您分析硬件-软件交互的性能Zynq UltraScale+ MPSoC和RFSoC设备，包括内存的使用和调度/操作系统效果。
在同一设计中混合使用浮点和定点操作。这个三角运算是使用标准Xilinx FPGA资源在浮点中实现的。
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在Xilinx Zynq SoC软件定义无线电平台上运行的无线应用程序原型，并在MATLAB和Simulink中进行实时分析。万博1manbetx
基于FPGA和Zynq soc平台的原型设计
要开始创建原型，可以下载万博1manbetx支持包针对预先配置的Xilinx FPGA和Zynq基于soc的空中直播评估平台软件定义无线电，无刷直流电动机控制，视频和图像处理与现场摄像头输入，或深度学习推理处理。HDL Coder然后指导您通过步骤来编程您的FPGA或SoC直接从Simulink，而不必编写HDL代码。万博1manbetx
您可以从多种技术中选择，以调试您的FPGA原型直接从MATLAB和Simulink。万博1manbetx你可以插入IP到:读或写AXI寄存器在MATLAB和机载存储器位置之间传输大信号或图像文件;捕获数据从信号内部到FPGA进行MATLAB分析;或者在运行的评估套件上测试您的算法FPGA-in-the-loop使用MATLAB或Simulink测试台万博1manbetx。
用于生产集成的HDL和IP核生成
大多数块支持HDL代码生成功能万博1manbetxHDL块特性它允许您指定自定义硬件实现选项，如管道插入、资源共享和RAM映射。HDL代码生成设置使您能够全局自定义优化、重置样式、时钟启用、命名约定等。再加上在Simulink中设计实现架构的能力，您可以完全控制万博1manbetx速度和面积优化用于Xilinx FPGA和Zynq SoC设备。
您可以生成可读可合成的RTL，以便与Vivado中的非算法内容集成®．如果您安装Zynq的HDL C万博1manbetxoder支持包，然后您可以生成一个使用各种AXI协议与Arm通信的IP核包装器®处理器和其他设备的IP。您可以使用嵌入式编码器®万博1manbetx支持Zynq的软件包生成驱动程序和应用软件，为Arm应用程序处理器编程。
从生成的HDL和IP核报告。IP Core Generation Report显示了设计输入和输出到AXI寄存器和协议的映射。
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