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设计一个PLL系统,从基本的基础块或一个参考架构系列开始。模拟和分析PLL系统,以验证关键性能指标,直到满足系统规范。
您可以通过提供每个基础块的规格和损伤,并将块连接到模拟不同的PLL架构模型(自下而上的方法)。或者,您可以从典型的PLL架构的完整系统级模型开始,并在满足您的系统规格(自上而下的方法)之前自定义这些模型。
使用测量和测试窗格在整个设计过程中,验证砌块和整个系统的规范是否存在缺陷。
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简单锁相环模型的设计与评价
此示例演示如何使用参考体系结构设计简单锁相环(PLL),并使用PLL测试台对其进行验证。
使用混合信号块集™ 对商用现货整数N锁相环(PLL)进行建模,该锁相环具有工作在4GHz左右的双模预分频器。您可以验证PLL性能,包括相位噪声。
预测锁相环(PLL)输出的相位噪声,使用PLL测试台模拟PLL,并将模拟结果与理论预测进行比较。
调整被动环路滤波器的组件以改善锁相环(PLL)系统的环路带宽。为了获得所需的循环频率响应,该示例使用Control系统工具箱™软件中提供的固定结构调谐方法计算环路滤波器参数。PLL系统使用来自混合信号块集™库的参考架构块进行建模。
使用混合信号块集建立数字锁相环模型™. 在数字锁相环中,相位检测由时间-数字转换器(TDC)执行,环路滤波由数字滤波器执行,并且振荡器是数字控制振荡器(DCO)。此示例演示了TDC的行为模型,使用DSP Systen工具箱中的双四元滤波器™ 作为数字环路滤波器,并使用VCO和DAC从混合信号块集中建模DCO。
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